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ATmega128
5. This requirement applies to all Atmel ? AVR ? ATmega128 Two-wire Serial Interface operation. Other devices connected to
the Two-wire Serial Bus need only obey the general f SCL requirement.
Figure 154. Two-wire Serial Bus Timing
SCL
t of
t LOW
t HIGH
t LOW
t r
SDA
t SU;STA
t HD;STA
t HD;DAT
t SU;DAT
t SU;STO
t BUF
SPI Timing
Characteristics
See Figure 155 and Figure 156 for details.
Table 134. SPI Timing Parameters
1
2
3
4
5
Description
SCK period
SCK high/low
Rise/Fall time
Setup
Hold
Mode
Master
Master
Master
Master
Master
Min
Typ
See Table 72
50% duty cycle
3.6
10
10
Max
6
7
8
9
10
Out to SCK
SCK to out
SCK to out high
SS low to out
SCK period
Master
Master
Master
Slave
Slave
4 ? t ck
0.5 ? t sck
10
10
15
ns
11
SCK high/low
(1)
Slave
2 ? t ck
12
13
14
15
16
17
18
Rise/Fall time
Setup
Hold
SCK to out
SCK to SS high
SS high to tri-state
SS low to SCK
Slave
Slave
Slave
Slave
Slave
Slave
Slave
10
10
20
2 ? t ck
15
10
1.6
μs
ns
Note:
1. In SPI Programming mode the minimum SCK high/low period is:
- 2 t CLCL for f CK < 12MHz
- 3 t CLCL for f CK >12MHz
323
2467X–AVR–06/11
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